Offene Arbeiten und Hiwi-Stellen

Bachelor-Arbeiten

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Modulextraktion aus kompletten Designs in RapidSoC
Java Verilog Hardware Software Praktisch
Ansprechpartner: Jakob Wenzel,  Frühester Beginn: sofort
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Statische Analyse des Speicherbedarfs von SpartanMC-Programmen
C/C++ Java Software Praktisch
Ansprechpartner: Jakob Wenzel,  Frühester Beginn: sofort

Master-Arbeiten

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Entwurf eines CNNs zur Schätzung von Syntheseeigenschaften von CGRAs
Java Software Anspruchsvoll
Ansprechpartner: Dennis Wolf,  Frühester Beginn: sofort
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Entwurf eines Tools zum Vergleich von CGRA Kompositions
Java Software
Ansprechpartner: Dennis Wolf,  Frühester Beginn: sofort
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Rückwärtsscheduling mit prädizierter Operationsausführung
Java Software
Ansprechpartner: Tajas Ruschke,  Frühester Beginn: sofort
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Rückwärtsscheduling zur vereinfachten Lösung des Verbindungsproblems
Java Software Theoretisch Englisch Deutsch
Ansprechpartner: Tajas Ruschke,  Frühester Beginn: sofort
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Matching von Datenflussgraphen mit Hilfe von ILP
Java Software Theoretisch
Ansprechpartner: Philip Gottschling,  Frühester Beginn: sofort
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Nutzung von GCC-Transformationen zur verbesserten automatischen Generierung von HW-Beschleunigern
C/C++ Verilog Software Praktisch
Ansprechpartner: Johanna Rohde,  Frühester Beginn: sofort

Projektseminare

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Implementierung einer Inlining Transformation für HLS auf Basis des GCC
C/C++ Verilog Software Praktisch
Ansprechpartner: Johanna Rohde,  Frühester Beginn: sofort
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Vergleich verschiedener Aliasing Algorithmen in High Level Synthesis Tools
C/C++ Software Englisch Deutsch
Ansprechpartner: Johanna Rohde,  Frühester Beginn: sofort

Hiwi-Job

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Informationen zu Projektseminaren

Die hier aufgeführten Projektseminare werden nur an Studenten vergeben, die NICHT Datentechnik (B.Sc. ETiT) vertiefen. Studenten mit der Vertiefungsrichtung Datentechnik absolvieren das Projektseminar im Zusammenhang mit der Bachelorarbeit und werden daher gesondert behandelt.

Legende

Gute Kenntnisse in C erforderlich
Gute Kenntnisse in Java erforderlich
Gute Kenntnisse in Verilog erforderlich
Gute Kenntnisse in VHDL erforderlich
Hardwareorientierte Arbeit
Softwareorientierte Arbeit
Praktische Arbeit
Theoretische Arbeit
In Englisch verfasste Arbeit wünschenswert
In Deutsch verfasste Arbeit wünschenswert
Zusätzliche HW/SW erforderlich
Anspruchsvolle Arbeit
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